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硬件工程師
2-2.4萬元/月3-5年
1.熟悉模擬電路和數(shù)字電路設(shè)計，具備高速ADC/DAC硬件設(shè)計相關(guān)的設(shè)計經(jīng)驗和能力；
2.精通Cadence原理圖設(shè)計。有Cadence經(jīng)驗、AMDFPGA硬件設(shè)計、獨立完成原理圖設(shè)計的能力優(yōu)先；
3.熟悉PCB設(shè)計流程和規(guī)范；
4.具備硬件設(shè)計文檔編寫的能力。
5.具備一定的高速信號完整性理論知識和實踐。
黃女士實名IP：重慶
深圳光明區(qū)上村社區(qū)蓮塘工業(yè)城A區(qū)第15棟
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